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  • Einführung
  • Das Grundproblem
  • Die Speicher-Hierarchie
  • Warum das funktioniert: Lokalität
  • Cache-Grundbegriffe
  • Cache-Mapping: wohin kommt ein Block?
  • Die drei Miss-Typen (3 C's)
  • Ersetzungs- und Schreibstrategien
  • Klausur-Faustregeln
  • Häufige Stolpersteine
ThemenSoftwaretechnikSpeicher-Hierarchie und Cache: Mapping, Hit/Miss, AMAT (Informatik)
Softwaretechnik·4Lerneinheiten·21min·Stand17.07.2026

Speicher-Hierarchie und Cache: Mapping, Hit/Miss, AMAT (Informatik).

Speicher-Hierarchie und Cache

Warum ist dein RAM riesig, aber die CPU trotzdem schnell? Weil zwischen CPU und RAM kleine, blitzschnelle Caches sitzen. Die Speicher-Hierarchie täuscht der CPU einen Speicher vor, der so schnell wie der Cache und so groß wie die Festplatte ist. Klausurpflicht in 6/8 Rechnerarchitektur-Modulen, oft mit Cache-Mapping- und AMAT-Rechnungen.

CPUs sind viel schneller als der Hauptspeicher. Eine CPU mit 3 GHz macht einen Takt in ~0,3 ns, ein RAM-Zugriff dauert aber ~100 ns. Ohne Tricks würde die CPU hunderte Takte auf jeden Speicherzugriff warten (Von-Neumann-Flaschenhals).

EbeneLatenzGrößeEigenschaft
Register< 1 ns~1 KBin der CPU, am schnellsten
L1-Cache~1 ns32-64 KBpro Kern
L2-Cache~4 ns256 KB-1 MBpro Kern
L3-Cache~10-40 ns8-32 MBgeteilt
Hauptspeicher (RAM)~100 ns8-32 GBflüchtig
SSD~50-150 µs256 GB-2 TBpersistent
Festplatte (HDD)~5-10 ms1-8 TBpersistent, billig

Faustregel: nach oben schneller, kleiner, teurer pro Byte. Nach unten langsamer, größer, billiger.

Programme greifen nicht zufällig auf den Speicher zu, sondern lokal:

  • Zeitliche Lokalität: kürzlich genutzte Daten werden bald wieder gebraucht (Schleifenvariablen, Funktionen). Lösung: im Cache behalten.
  • Räumliche Lokalität: benachbarte Daten werden bald gebraucht (Array-Elemente, Code-Sequenzen). Lösung: ganze Blöcke (Cache-Lines) laden, nicht einzelne Bytes.
  • Cache-Line / Block: kleinste Einheit, die der Cache lädt (z.B. 64 Byte).
  • Hit: die gesuchten Daten sind im Cache (schnell).
  • Miss: die Daten fehlen, müssen aus der nächsten Ebene geholt werden (langsam).
  • Hit-Rate: Anteil der Treffer. Miss-Rate = 1 − Hit-Rate.

Die wichtigste Formel: AMAT

AMAT = Trefferzeit + Miss-Rate × Miss-Strafe

(Average Memory Access Time, mittlere Speicherzugriffszeit.) Beispiel: Trefferzeit 1 ns, Miss-Rate 5 %, Miss-Strafe 100 ns → AMAT = 1 + 0,05 × 100 = 6 ns.

Die Speicheradresse wird zerlegt:

Adresse = Tag | Index | Offset

  • Offset: welches Byte im Block (Offset-Bits = log₂(Blockgröße)).
  • Index: welche Cache-Zeile/welcher Satz (Index-Bits = log₂(Anzahl Sätze)).
  • Tag: der Rest, identifiziert den Block eindeutig.
MappingBlock kann liegen in...Eigenschaft
Direct-Mappedgenau EINER Zeile (Index)einfach, schnell, viele Konflikte
Voll-assoziativJEDER Zeileflexibel, teuer (alle Tags vergleichen)
n-fach satz-assoziativeiner von n Zeilen pro SatzKompromiss (üblich: 4-/8-fach)
TypUrsache
Compulsory (Cold) Misserster Zugriff auf einen Block (Cache noch leer)
Capacity MissCache zu klein für alle aktiven Daten
Conflict Missmehrere Blöcke konkurrieren um denselben Index (nur bei Direct/Satz-assoziativ)
  • Ersetzung (welcher Block fliegt raus?): LRU (Least Recently Used), FIFO, Random. LRU nutzt die zeitliche Lokialität am besten.
  • Schreiben: Write-Through (sofort auch in RAM, einfach, langsam) vs. Write-Back (erst beim Verdrängen zurückschreiben, schnell, braucht Dirty-Bit).

1. Hierarchie: nach oben schnell/klein/teuer, nach unten langsam/groß/billig.

2. Lokalität: zeitlich (wieder) + räumlich (benachbart). Caches leben davon.

3. Adresse = Tag | Index | Offset. Offset = log₂(Blockgröße), Index = log₂(Sätze).

4. AMAT = Trefferzeit + Miss-Rate × Miss-Strafe.

5. 3 Mapping-Arten: Direct-Mapped, voll-assoziativ, n-fach satz-assoziativ.

6. 3 C's: Compulsory, Capacity, Conflict.

1. Tag und Index vertauschen. Der Index sind die MITTLEREN Bits (wählt die Zeile), der Tag die OBEREN (identifiziert den Block), der Offset die UNTEREN.

2. Register als Teil des RAM sehen. Register sind in der CPU, ganz oben in der Hierarchie, nicht im Hauptspeicher.

3. Conflict-Miss bei voll-assoziativem Cache. Conflict-Misses gibt es nur bei Direct-Mapped oder satz-assoziativ, nicht bei voll-assoziativ (dort nur Compulsory + Capacity).

4. Hit-Rate mit Miss-Rate verwechseln. Miss-Rate = 1 − Hit-Rate. Bei 95 % Hit-Rate ist die Miss-Rate 5 %.

5. Cache lädt einzelne Bytes. Nein, der Cache lädt immer ganze Blöcke (Cache-Lines), das nutzt die räumliche Lokalität.

6. SSD und Cache verwechseln. Die SSD ist persistenter Massenspeicher unten in der Hierarchie, der Cache ist flüchtiger SRAM oben in der CPU.

Erkunde im ersten Tab die Speicher-Pyramide mit Latenz und Größe pro Ebene. Im zweiten Tab steuerst du einen Direct-Mapped-Cache: wähle eine Adresse, sieh ihre Zerlegung in Tag, Index und Offset, und löse mit "Zugriff" einen Hit oder Miss aus. Die Hit-Rate wird live mitgezählt.

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Klausur-Tipp: Greife zweimal auf dieselbe Adresse zu (erst Miss, dann Hit = zeitliche Lokalität). Probiere dann zwei Adressen mit gleichem Index, aber anderem Tag, sie verdrängen sich gegenseitig (Conflict-Miss). Übe das Zerlegen einer Adresse in Tag/Index/Offset.

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Inhalt dieser Übersicht

  1. Erklärung(Erklärung)
  2. Interaktiv verstehen(Visualisierung / Interaktiv)
  3. Praxis-Übung(Quiz / Klausurfragen)
  4. Klausur-Quiz(Quiz / Klausurfragen)
Teil 1·Erklärung

Erklärung

Speicher-Hierarchie und Cache

Warum ist dein RAM riesig, aber die CPU trotzdem schnell? Weil zwischen CPU und RAM kleine, blitzschnelle Caches sitzen. Die Speicher-Hierarchie täuscht der CPU einen Speicher vor, der so schnell wie der Cache und so groß wie die Festplatte ist. Klausurpflicht in 6/8 Rechnerarchitektur-Modulen, oft mit Cache-Mapping- und AMAT-Rechnungen.

Das Grundproblem

CPUs sind viel schneller als der Hauptspeicher. Eine CPU mit 3 GHz macht einen Takt in ~0,3 ns, ein RAM-Zugriff dauert aber ~100 ns. Ohne Tricks würde die CPU hunderte Takte auf jeden Speicherzugriff warten (Von-Neumann-Flaschenhals).

Die Speicher-Hierarchie

EbeneLatenzGrößeEigenschaft
Register< 1 ns~1 KBin der CPU, am schnellsten
L1-Cache~1 ns32-64 KBpro Kern
L2-Cache~4 ns256 KB-1 MBpro Kern
L3-Cache~10-40 ns8-32 MBgeteilt
Hauptspeicher (RAM)~100 ns8-32 GBflüchtig
SSD~50-150 µs256 GB-2 TBpersistent
Festplatte (HDD)~5-10 ms1-8 TBpersistent, billig

Faustregel: nach oben schneller, kleiner, teurer pro Byte. Nach unten langsamer, größer, billiger.

Warum das funktioniert: Lokalität

Programme greifen nicht zufällig auf den Speicher zu, sondern lokal:

  • Zeitliche Lokalität: kürzlich genutzte Daten werden bald wieder gebraucht (Schleifenvariablen, Funktionen). Lösung: im Cache behalten.
  • Räumliche Lokalität: benachbarte Daten werden bald gebraucht (Array-Elemente, Code-Sequenzen). Lösung: ganze Blöcke (Cache-Lines) laden, nicht einzelne Bytes.

Cache-Grundbegriffe

  • Cache-Line / Block: kleinste Einheit, die der Cache lädt (z.B. 64 Byte).
  • Hit: die gesuchten Daten sind im Cache (schnell).
  • Miss: die Daten fehlen, müssen aus der nächsten Ebene geholt werden (langsam).
  • Hit-Rate: Anteil der Treffer. Miss-Rate = 1 − Hit-Rate.
Die wichtigste Formel: AMAT

AMAT = Trefferzeit + Miss-Rate × Miss-Strafe

(Average Memory Access Time, mittlere Speicherzugriffszeit.) Beispiel: Trefferzeit 1 ns, Miss-Rate 5 %, Miss-Strafe 100 ns → AMAT = 1 + 0,05 × 100 = 6 ns.

Cache-Mapping: wohin kommt ein Block?

Die Speicheradresse wird zerlegt:

Adresse = Tag | Index | Offset

  • Offset: welches Byte im Block (Offset-Bits = log₂(Blockgröße)).
  • Index: welche Cache-Zeile/welcher Satz (Index-Bits = log₂(Anzahl Sätze)).
  • Tag: der Rest, identifiziert den Block eindeutig.
MappingBlock kann liegen in...Eigenschaft
Direct-Mappedgenau EINER Zeile (Index)einfach, schnell, viele Konflikte
Voll-assoziativJEDER Zeileflexibel, teuer (alle Tags vergleichen)
n-fach satz-assoziativeiner von n Zeilen pro SatzKompromiss (üblich: 4-/8-fach)

Die drei Miss-Typen (3 C's)

TypUrsache
Compulsory (Cold) Misserster Zugriff auf einen Block (Cache noch leer)
Capacity MissCache zu klein für alle aktiven Daten
Conflict Missmehrere Blöcke konkurrieren um denselben Index (nur bei Direct/Satz-assoziativ)

Ersetzungs- und Schreibstrategien

  • Ersetzung (welcher Block fliegt raus?): LRU (Least Recently Used), FIFO, Random. LRU nutzt die zeitliche Lokialität am besten.
  • Schreiben: Write-Through (sofort auch in RAM, einfach, langsam) vs. Write-Back (erst beim Verdrängen zurückschreiben, schnell, braucht Dirty-Bit).

Klausur-Faustregeln

1. Hierarchie: nach oben schnell/klein/teuer, nach unten langsam/groß/billig.

2. Lokalität: zeitlich (wieder) + räumlich (benachbart). Caches leben davon.

3. Adresse = Tag | Index | Offset. Offset = log₂(Blockgröße), Index = log₂(Sätze).

4. AMAT = Trefferzeit + Miss-Rate × Miss-Strafe.

5. 3 Mapping-Arten: Direct-Mapped, voll-assoziativ, n-fach satz-assoziativ.

6. 3 C's: Compulsory, Capacity, Conflict.

Häufige Stolpersteine

1. Tag und Index vertauschen. Der Index sind die MITTLEREN Bits (wählt die Zeile), der Tag die OBEREN (identifiziert den Block), der Offset die UNTEREN.

2. Register als Teil des RAM sehen. Register sind in der CPU, ganz oben in der Hierarchie, nicht im Hauptspeicher.

3. Conflict-Miss bei voll-assoziativem Cache. Conflict-Misses gibt es nur bei Direct-Mapped oder satz-assoziativ, nicht bei voll-assoziativ (dort nur Compulsory + Capacity).

4. Hit-Rate mit Miss-Rate verwechseln. Miss-Rate = 1 − Hit-Rate. Bei 95 % Hit-Rate ist die Miss-Rate 5 %.

5. Cache lädt einzelne Bytes. Nein, der Cache lädt immer ganze Blöcke (Cache-Lines), das nutzt die räumliche Lokalität.

6. SSD und Cache verwechseln. Die SSD ist persistenter Massenspeicher unten in der Hierarchie, der Cache ist flüchtiger SRAM oben in der CPU.

Teil 2·Visualisierung / Interaktiv

Interaktiv verstehen

Speicher-Hierarchie, interaktiv

Erkunde im ersten Tab die Speicher-Pyramide mit Latenz und Größe pro Ebene. Im zweiten Tab steuerst du einen Direct-Mapped-Cache: wähle eine Adresse, sieh ihre Zerlegung in Tag, Index und Offset, und löse mit "Zugriff" einen Hit oder Miss aus. Die Hit-Rate wird live mitgezählt.

Interaktive Visualisierung

Interaktive Komponente: probiere sie im Topic-Player oben aus.

Klausur-Tipp: Greife zweimal auf dieselbe Adresse zu (erst Miss, dann Hit = zeitliche Lokalität). Probiere dann zwei Adressen mit gleichem Index, aber anderem Tag, sie verdrängen sich gegenseitig (Conflict-Miss). Übe das Zerlegen einer Adresse in Tag/Index/Offset.

Teil 3·Quiz / Klausurfragen

Praxis-Übung

Speicher-Hierarchie, Praxis-Übung

6 Aufgaben zu Hierarchie, Lokalität und Cache.

Klausurfragen mit Lösungen (6)

F1.Welche Aussage über die Speicher-Hierarchie ist richtig?

Antwort: Je weiter oben, desto schneller, kleiner und teurer pro Byte

Erklärung: In der Speicher-Hierarchie gilt: nach oben (Register, Cache) schneller, kleiner und teurer pro Byte; nach unten (RAM, SSD, HDD) langsamer, größer und billiger. Der L1-Cache (~1 ns) ist viel schneller als RAM (~100 ns). Klausur-Grundprinzip.

F2.Was bedeutet ein Cache-Hit?

Antwort: Die gesuchten Daten liegen bereits im Cache

Erklärung: Ein Cache-Hit bedeutet, dass die gesuchten Daten bereits im Cache liegen, der Zugriff ist schnell. Ein Miss bedeutet, die Daten fehlen und müssen aus der nächsten (langsameren) Ebene nachgeladen werden. Die Hit-Rate ist der Anteil der Treffer. Klausur-Grundbegriff.

F3.Ordne den Adressteil seiner Funktion im Cache zu.

Zuordnungen:

  • Offset → welches Byte im Block (untere Bits)
  • Index → welche Cache-Zeile/Satz (mittlere Bits)
  • Tag → identifiziert den Block (obere Bits)
  • Valid-Bit → ob die Zeile gültige Daten enthält

Erklärung: Die Adresse wird zerlegt: Offset (untere Bits) = Byte im Block, Index (mittlere Bits) = Cache-Zeile/Satz, Tag (obere Bits) = Block-Identifikation. Das Valid-Bit sagt, ob die Zeile überhaupt gültige Daten hat. Klausur-Pflicht-Zuordnung.

Typ: Zuordnung

F4.Bei einem Direct-Mapped-Cache mit 8 Zeilen: wie viele Index-Bits braucht man?

Antwort: 3

Erklärung: Index-Bits = log₂(Anzahl Zeilen) = log₂(8) = 3. Mit 3 Bits adressiert man genau 8 Cache-Zeilen (000 bis 111). Bei 16 Zeilen wären es 4 Index-Bits. Klausur-Rechenregel.

F5.Ein Cache lädt bei einem Miss immer einen ganzen Block (Cache-Line), nicht nur das angeforderte einzelne Byte.

Antwort: Wahr

Erklärung: RICHTIG. Der Cache lädt bei einem Miss immer eine ganze Cache-Line (z.B. 64 Byte), nicht nur das eine angeforderte Byte. Das nutzt die räumliche Lokalität: benachbarte Daten werden wahrscheinlich bald gebraucht und sind dann schon da. Klausur-Konzept.

Typ: Wahr/Falsch

F6.Trefferzeit 2 ns, Miss-Rate 10 %, Miss-Strafe 200 ns. Wie groß ist die mittlere Zugriffszeit (AMAT)?

Antwort: 22 ns

Erklärung: AMAT = Trefferzeit + Miss-Rate × Miss-Strafe = 2 + 0,10 × 200 = 2 + 20 = 22 ns. Die Miss-Strafe wird mit der Miss-Rate gewichtet und auf die Trefferzeit addiert. Schon 10 % Misses verzehnfachen die Zugriffszeit hier. Klausur-Rechenaufgabe.

Teil 4·Quiz / Klausurfragen

Klausur-Quiz

Speicher-Hierarchie, Klausur-Quiz

6 Klausur-Fragen zu Cache-Mapping, Miss-Typen und Lokalität.

Klausurfragen mit Lösungen (6)

F1.Welche zwei Arten von Lokalität nutzen Caches aus?

Antwort: Zeitliche und räumliche Lokalität

Erklärung: Caches nutzen zeitliche Lokalität (kürzlich genutzte Daten werden bald wieder gebraucht, z.B. Schleifenvariablen) und räumliche Lokalität (benachbarte Daten werden bald gebraucht, z.B. Array-Elemente). Ohne Lokalität wären Caches nutzlos. Klausur-Pflichtwissen.

F2.Bei welcher Mapping-Art kann ein Speicherblock in JEDER Cache-Zeile liegen?

Antwort: Voll-assoziativ

Erklärung: Beim voll-assoziativen Cache kann ein Block in JEDER Zeile liegen, das ist am flexibelsten (keine Conflict-Misses), aber teuer, weil beim Suchen alle Tags parallel verglichen werden müssen. Direct-Mapped erlaubt nur eine Zeile, satz-assoziativ einen von n Plätzen pro Satz. Klausur-Vergleich.

F3.Ordne den Miss-Typ seiner Ursache zu.

Zuordnungen:

  • Compulsory (Cold) → erster Zugriff auf einen Block
  • Capacity → Cache zu klein für die aktiven Daten
  • Conflict → Blöcke konkurrieren um denselben Index
  • Write-Back → Schreibstrategie mit Dirty-Bit

Erklärung: Die 3 C's: Compulsory (erster, unvermeidbarer Zugriff), Capacity (Cache zu klein), Conflict (Index-Kollision bei Direct/Satz-assoziativ). Write-Back ist dagegen eine Schreibstrategie (erst beim Verdrängen in den RAM, markiert per Dirty-Bit). Klausur-Pflicht-Zuordnung.

Typ: Zuordnung

F4.Eine 32-Bit-Adresse, Blockgröße 16 Byte, 256 Cache-Zeilen (direct-mapped). Wie viele Offset- und Index-Bits?

Antwort: Offset 4, Index 8

Erklärung: Offset-Bits = log₂(Blockgröße) = log₂(16) = 4. Index-Bits = log₂(Zeilen) = log₂(256) = 8. Der Tag bekommt den Rest: 32 − 4 − 8 = 20 Bits. Vorgehen: erst Offset (Blockgröße), dann Index (Zeilen), Tag ist der Rest. Klausur-Rechenaufgabe.

F5.Bei einem voll-assoziativen Cache treten keine Conflict-Misses auf.

Antwort: Wahr

Erklärung: RICHTIG. Conflict-Misses entstehen, wenn mehrere Blöcke um denselben Index konkurrieren, das gibt es nur bei Direct-Mapped oder satz-assoziativ. Im voll-assoziativen Cache kann jeder Block überall liegen, also keine Index-Konflikte, nur Compulsory- und Capacity-Misses. Klausur-Stolperstein.

Typ: Wahr/Falsch

F6.Warum verbessert das Erhöhen der Blockgröße die Hit-Rate nur bis zu einem Punkt und kann sie danach verschlechtern?

Antwort: Größere Blöcke nutzen mehr räumliche Lokalität, aber zu große Blöcke verdrängen nützliche Daten und erhöhen die Miss-Strafe

Erklärung: Größere Blöcke nutzen anfangs mehr räumliche Lokalität (mehr benachbarte Daten vorgeladen → bessere Hit-Rate). Werden Blöcke zu groß, passen weniger in den Cache, nützliche Daten werden verdrängt (mehr Capacity/Conflict-Misses) und die Miss-Strafe steigt (mehr nachzuladen). Es gibt ein Optimum. Klausur-Transferfrage.

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